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【赛灵思中国通讯54期】UltraScale为高带宽设计带来板载Interlaken

发布者:jackzhang 时间:2014-12-20 19:56:03

赛灵思在其UltraScale FPGA上集成了Interlaken IP,可简化包处理系统互联。

 

 作者:Martin Gilpatric

 赛灵思公司收发器技术市场营销经理  martin.gilpatric@xilinx.com


带宽是个有趣的东西。十年前,大多数人都不清楚什么是“每秒字节”。而今天,在线视频、智能手机和各种现代化互联社会不可或缺的设备让带宽成为所有人关注的问题。这些应用告诉人们,带宽非常重要,人们也清晰地意识到需要更高的带宽。

 

遗憾的是,高级堆栈顶层观点会制约为家庭以及便携式设备提供更多比特与字节所需的技术发展。所有这些数据都要求我们的基础设施必须跟上发展要求。过去依靠10Gbps光学技术的互联机制现在已经发展到40乃至100Gbps,而不久的将来还有望推进到400Gbps


 

当今产业中的INTERLAKEN

 

在整个过程中,基础包处理任务和架构并没有发生巨大变化。同样,100Gbps系统面对的许多封装、功耗和热性能限制与其前代技术也一样。这意味着系统所有组件都需要大幅提高速度。更重要的是,这些器件之间的互联必须能够很容易扩展。系统中使用的FICNPUMAC及其它ASSP来自众多不同的供应商,这导致问题进一步复杂化。这些器件采用各种互联宽度和速率来实现目标吞吐量。

 

现在,赛灵思和Interlaken协议已着手协助解决包处理功能之间的社交互联瓶颈问题。由思科和Cortina合力打造的Interlaken旨在应对这些挑

战。赛灵思 FPGA可通过高性能可编程逻辑和高性能收发器轻松实现这项标准。以下三个方面使得Interlaken成为应对这些难题的最佳协议:

其具备高度可扩展性;Interlaken非常适用于OTN 和以太网系统;它是一项开放式协议。

 

从最基本的层面说,Interlaken旨在最大限度地提升灵活性和可扩展性。该规范没有强行要求预定义的线路速度或信道宽度。举例来说,这意味着您实现150Gbps的接口就能对100G以太网数据路径(带其它包头)进行封装,12条信道每条线路12.5 Gbps或者六条信道每条分别为25 Gbps。无论哪种情况,Interlaken的逻辑接口均可得到保持,同时简化了其它设计。此外,这种灵活性也使Interlaken适用于细分市场应用,如与TCAM协同工作的后备接口。


 

 

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